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存儲器選擇了DS1265AB，它是SRAM存儲器，具有存儲速度快的優(yōu)點，并能夠在系統(tǒng)掉電時保存數據10年。DS1265具有1 MB的容量，20根地址線，8根數據線，另有WE，OE，CE信號輸入端。
CPLD選用EPM7128具有價格便宜、計數頻率高等優(yōu)點。將存儲器SRAM接到CPLD的IO引腳上，配合時序便能達到對SRAM讀寫的要求，原理圖，如圖6所示。
圖6 CPLD與SRAM 連接示意圖
編寫CPLD程序使得輸出時序滿足SRAM的存儲要求，當然對于設計的具體要求，利用兩片SRAM分別存儲奇偶場的數據，SRAM的切換是由奇偶場信號 FID控制多片74HC245實現的，詳細過程，如圖7所示。當FID處于高電平時，此時M1和M4使能，此時CPLD將地址信號CPLDaddr輸入 SRAM1中，DSP將地址信號DSPaddr輸入至SRAM2中，同時M6和M8使能，由圖中可以看出，此時CPLD正向SRAM1寫入數據，而DSP 正從SRAM2中讀取數據，同時M10使能，CPLD的信號CPLDctl控制SRAM1的讀寫，而DSP的信號DSPctl控制SRAM2的讀寫，當 FID轉為低電平時，正好將SRAM1和SRAM2實現了交換。以這種方式構建的系統(tǒng)，能同時將視頻的兩場數據同時記錄下來，實現了CPLD和DSP的有機結合。至此CPLD的任務就是將有效的圖像數據存儲到對應的SRAM中，當TVP5147芯片AVID引腳上升沿時，置地址為初始值00h，即從首地址依次往后寫入。每一個數據時鐘信號DATACLK上升沿時將TVP5147輸出的Y［9…2］存儲到當前地址單元，Y0和Y1位舍棄，因為所選擇的 SRAM數據位為8位，當放棄Y0和Y1位后，降低了圖像數據的精度，但對識別效果的影響卻很小，然后隨著DATACLK每次上升沿的來臨，CPLD將地址單元加1，這樣實現每一場數據的寫入。當切換至另一場數據時，執(zhí)行的過程相同，只是存儲的對象被74HC245強制更改，如此循環(huán)，便可將每場數據記錄下來。
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